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本帖最后由 2405cwc 于
13:52 编辑
xt926 maxx 的JTAG 接口定义已确定 可以进行jtag测试 救砖
1、xt926 jtag软件可以用h-jtag
2、XT926 jtag点定义见附件，感谢qq网友用ort提供接口定义
3、jtag线接法
& &&&常见的JTAG cable结构都比较简单，一端是DB25，接到电脑的并口上，中间经过74HC244和一些电阻实现电平转换(5V3.3V?)(也有比较猥琐的只用了 几个100 Ohm电阻的方案)，另一端的JTAG header接到目标板的JTAG interface。
并口DB25原先主要是用来连接打印机，其引脚定义如下：
25 Pin D-Sub SPP SIGNAL DIRECTION IN/OUT
1& && && && &/Strobe& && && && && &In/Out
2& && && && &Data 0& && && && && & Out
3& && && && &Data 1& && && && && & Out
4& && && && &Data 2& && && && && & Out
5& && && && &Data 3& && && && && & Out
6& && && && &Data 4& && && && && & Out
7& && && && &Data 5& && && && && & Out
8& && && && &Data 6& && && && && & Out
9& && && && &Data 7& && && && && & Out
10& && && & /ACK& && && && && && & In
11& && && &Busy& && && && && && &&&In
12& && && &Paper Out& && && &&&In
13& && && &Select& && && && && && &In
14& && && &/Line Feed& && && & In/Out
15& && && &/Error& && && && && && & In
16& && && &/INIT& && && && && && && &In/Out
17& && && &/Select In& && && && & In/Out
18-25& &Ground GND
可见，数据线Pin2~Pin9可以用来发送数据，Pin10~Pin13等可以用来接收数据。
JTAG的数据传输形式是串行，主要使用了以下引脚：
TDI (Test Data In)
TDO (Test Data Out)
TCK (Test ClocK)
TMS (Test Mode Select)
TRST (Test ReSeT) optional.
因此，DB25-JTAG实际上只利用了DB25的少数几根线。但由于DB25的8条数据线都可以作为output，市面上就出现了各种使用不同Pin Assignment的JTAG线。
例如Wiggler的Pin assignment:
TMS : Pin3 (D1)
TCK : Pin4 (D2)
TDI : Pin5 (D3)
TDO : Pin11 (Busy)
SRST& &: Pin2 (D0)
TRST& &: Pin6 (D4)
(参见Wiggler的电路图，但最后的nSRST和nTRST可能不一定用到，并且在H-JTAG中的定义也不一样，TRST是Pin2，没有 SRST)
4、xt926全分区文件下载地址：/s/1kTIfQ3l&&
注意：jtag只需要刷入分区表和boot分区就行
5、xt926 jtag接口位置 针脚名/s/1bnEYytD
6、台式机lpt接口（主板未引出长方形接口定义）/s/1dD50PHJ
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TA的每日心情慵懒 00:17签到天数: 31 天[LV.5]常住居民I
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本帖最后由 2405cwc 于
22:35 编辑
链接修改完毕。。。
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TA的每日心情擦汗 14:48签到天数: 1 天[LV.1]初来乍到
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SWD与JTAG之间的区别
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很多时候，我们做在线仿真的时候，有时候能用Jtag，有时候是Jlink，有时候又是（），哈哈，这么多接口，你分得清吗。。。
对了，还有本文提到的SWD。
SWD 仿真模式概念简述
一、SWD 和传统的调试方式区别
模式比 JTAG 在高速模式下面更加可靠。 在大数据量的情况下面
下载程序会失败, 但是 SWD 发生的几率会小很多。基本使用 JTAG 仿真模式的情况下是可以直接使用 SWD 模式的, 只要你的仿真器支持。 所以推荐大家使用这个模式。
& & 2. 在大家
刚好缺一个的时候, 可以使用 SWD 仿真, 这种模式支持更少的引脚。
& & 3. 在大家板子的体积有限的时候推荐使用 SWD 模式, 它需要的引脚少, 当然需要的 PCB 空间就小啦！ 比如你可以选择一个很小的 2.54 间距的 5 芯端子做仿真接口。
二、仿真器对 SWD 模式支持情况
1. 市面上的常用仿真器对 SWD 模式支持情况
(1) JLINKV6 支持 SWD 仿真模式， 速度较慢。
(2) JLINKV7 比较好的支持 SWD 仿真模式, 速度有了明显的提高，速度是 JLINKV6 的 6 倍。
(3) JLINKV8 非常好的支持 SWD 仿真模式, 速度可以到 10M。
(4) ULINK1 不支持 SWD 模式。
(5) 盗版 ULINK2 非常好的支持 SWD 模式， 速度可以达到 10M。
(6) 正版 ULINK2 非常好的支持 SWD 模式， 速度可以达到 10M。
本开发板使用三线制SWD（GND，SWDIO，SWCLK）。
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接口不一样啊,这个要是分不清,怎么开发呢
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接口可以通用的吧
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接口不一样啊,这个要是分不清,怎么开发呢
关键在于知道什么样的接口有什么样的特性，有的jlink和jtag都能用，可是选择什么合适？
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接口可以通用的吧
通用的，也看仿真器的支持吧
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链接接口不同，传输协议也不同，还有繁简的差别。需要做个整理。
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SWD省接口，其它的倒没注意
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keil 官网说的很清晰哦.
目标板已经上电的情况下, ULINK 只需要3跟线连到目标板:
SWCLK SWDIO GND.
但是部分MCU下载完后要按复位才能跑起来,
(41.47 KB, 下载次数: 79)
09:22 上传
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学习了，MARK
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SWD省接口，其它的倒没注意
我们实验室一直用SWD，这样板子设计可以节省空间
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JLink、JTAG接口详细图解
1脚：通常连接到目标板的vdd，用来检测目标系统是否供电；检测原理上图中有简单的说明。
2脚：原版的JLink这个引脚没有使用，不提供Vsupply输出，而很多改造版的JLink通过跳线选择从该引脚输出3.3V的电压给外边，我的就是这样的。
可以到网上找JLink的原理图看看。
JTAG interface signals
The following table describes the signals on the JTAG interfaces:
Table&1.&JTAG signals
Description
This pin is connected in the RVI run control unit, but is not supported in the current release of the software. It is reserved for compatibility with other equipment to be used as a debug acknowledge signal from the target system. It is recommended that this
signal is pulled LOW on the target.
This pin is connected in the RVI run control unit, but is not supported in the current release of the software. It is reserved for compatibility with other equipment to be used as a debug request signal to the target system. The RVI software maintains this
signal as LOW.
When applicable,RVI uses the scan chain 2 of the processor to put the processor in debug state. It is recommended that this signal is pulled LOW on the target.
Input/output
Active Low output from RVI to the target system reset, with a 4.7kΩ pull-up resistor for de-asserted state. This is also an input to RVI so that a reset initiated on the target can be reported to the debugger.
This pin must be pulled HIGH on the target to avoid unintentional resets when there is no connection.
Active Low output from RVI to the Reset signal on the target JTAG port, driven to the VTref voltage for de-asserted state. This pin must be pulled HIGH on the target to avoid unintentional resets when there is no connection.
Return Test Clock signal from the target JTAG port to RVI. Some targets must synchronize the JTAG inputs to internal clocks. To assist in meeting this requirement, you can use a returned, and retimed,&TCK&to
dynamically control the&TCK&rate. RVI provides Adaptive Clock Timing, that waits for&TCK&changes
to be echoed correctly before making more changes. Targets that do not have to process&TCK&can ground this pin.
RTCK&is not supported in&Serial Wire Debug&(SWD) mode.
Test Clock signal from RVI to the target JTAG port. It is recommended that this pin is pulled LOW on the target.
Test Data In signal from RVI to the target JTAG port. It is recommended that this pin is pulled HIGH on the target.
Test Data Out from the target JTAG port to RVI. It is recommended that this pin is pulled HIGH on the target.
Test Mode signal from RVI to the target JTAG port. This pin must be pulled HIGH on the target so that the effect of any spurious&TCKs when there is no connection is benign.
This pin is not connected in the RVI unit. It is reserved for compatibility with other equipment to be used as a power feed from the target system.
This is the target reference voltage. It indicates that the target has power, and It must be at least 0.628V.&VTref&is normally fed from&Vdd&on
the target hardware and might have a series resistor (though this is not recommended). There is a 10kΩ pull-down resistor on&VTref&in RVI.&
ARM系统的JTAG接口的设计不当往往使硬件系统无法调试，所以在设计ARM系统前要先熟悉ARM系统的JTAG接口的定义和常见问题。
1．ARM系统的JTAG接口是如何定义的？ 每个PIN又是如何连接的？
下图是JTAG接口的信号排列示意：
接口是一个20脚的IDC插座。下表给出了具体的信号说明：
表 1 JTAG引脚说明
接口电平参考电压，通常可直接接电源
(可选项) JTAG复位。在目标端应加适当的上拉电阻以防止误触发。
Test Data In from Dragon-ICE to target.
Test Mode Select
Test Clock output from Dragon-ICE to the target
(可选项) Return Test Clock。由目标端反馈给Dragon-ICE的时钟信号，用来同步TCK信号的产生。不使用时可以直接接地。
Test Data Out from target to Dragon-ICE.
Input/Output
(可选项) System Reset，与目标板上的系统复位信号相连。可以直接对目标系统复位，同时可以检测目标系统的复位情况。为了防止误触发，应在目标端加上适当的上拉电阻。
2．目标系统如何设计？
　&目标板使用与Dragon-ICE一样的20脚针座，信号排列见表1。RTCK和 nTRST这两个信号根据目标ASIC有否提供对应的引脚来选用。nSRST则根据目标系统的设计考虑来选择使用。下面是一个典型的连接关系图：
　　复位电路中可以根据不同的需要包含上电复位、手动复位等等功能。如果用户希望系统复位信号nSRST能同时触发JTAG口的复位信号nTRST，则可以使用一些简单的组合逻辑电路来达到要求。后面给出了一种电路方案的效果图。
　　　　　　　　　　　　
　图 3 一个复位电路结构的例子
　　在目标系统的PCB设计中，最好把JTAG接口放置得离目标ASIC近一些，如果这两者之间的连线过长，会影响JTAG口的通信速率。
　　另外电源的连线也需要加以额外考虑，因为Dragon-ICE要从目标板上吸取超过100mA的大电流。最好能有专门的敷铜层来供电，假如只能使用连线供电的话，最小线宽不应小于10mil (0.254mm)。
3. 14脚JTAG如何与20JTAG连接?
　 Dragon-ICE使用工业标准的20脚JTAG插头，但是有些老的系统采用一种14脚的插座
。这两类接口的信号排列如下：
　　这两类接口之间的信号电气特性都是一样的，因此可以把对应的信号直接连起来进
行转接。Dragon-ICE配备这种转接卡，随机配备。
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20脚用杜邦线相连 JLINK的20针JTAG的7脚（JTMS）、9脚（JTCK）
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1、 JTAG接口在嵌入式中的作用
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