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在软件结构设计中，好的软件结构设计应该力求做到（)。A．顶层扇出较少，中间扇出较高，底层模块低扇入
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在软件结构设计中，好的软件结构设计应该力求做到()。A．顶层扇出较少，中间扇出较高，底层模块低扇入B．顶层扇出较高，中间扇出较少，底层模块高扇入C．顶层扇入较少，中间扇出较高，底层模块高扇入D．顶层扇入较高，中间扇出较少，底层模块低扇入请帮忙给出正确答案和分析，谢谢！
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扇入系数系数,扇入系数是什么意思
扇入系数NI: 门电路允许的输入端的数目，称为该门电路的扇入系数。一般NI≤5，最多不超过8。实际应用中若要求门电路的输入端数目超过它的扇入系数，可使用与扩展器或者或扩展器来增加输入端数目，也可改用分级实现的方法。典型门电路的扇入系数对NOR为4，对NAND为6。实际应用中若要求门电路的输入端数目小与它的扇入系数，可将多余的输入端接高电平或低电平，这取决于门电路的逻辑功能。
–门电路输入端的增加，会使串联的MOS管的总的等效电阻增加，会使输出电压偏离电源电压或地电平。(具体后面TTL逻辑门电路有说明) 　　在软件工程中，系统总体结构设计原则之一：模块的扇出系数扇入系数要设置合理。　　模块的扇出系数:模块直接调用其他模块的个数. 　　模块的扇入系数:模块被其他模块调用时,直接调用的它的模块个数. 　　模块的扇入,扇出系数设置: 　　好的系统的平均扇入,扇出系统通常是3或4,一般不应超过7. 　　菜单调用型模块扇入与扇出系统,公用模块扇入系统可以大一些. 　　模块的规模设置 　　过大的模块:使系统分解得不充分. 　　过小的模块:降低模块的独立性,造成系统接口的复杂性. 　　最好的模块规模:程序系数限制在1～2页纸内.
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关于 FPGA 内部信号扇入扇出
& 作者：天马行空W & 来源： 博客园-woshitianma &
其可靠性，最终引起器件失效。
1.原意：&&The&number&of&circuits&that&can&be&fed&input&signals&from&an&output&device.&&扇出，输出可从输出设备输入信号的电路的数量&。&扇出（fan-out）是定义单个逻辑门能够驱动的数字信号输入最大量的术语。大多数TTL逻辑门能够为10个其他数字门或驱动器提供信号。因而，一个典型的TTL逻辑门有10个扇出信号。&　　在一些数字系统中，必须有一个单一的TTL逻辑门来驱动10个以上的其他门或驱动器。这种情况下，被称为缓冲器的驱动器可以用在TTL逻辑门与它必须驱动的多重驱动器之间。这种类型的缓冲器有25至30个扇出信号。逻辑反向器（也被称为非门）在大多数数字电路中能够辅助这一功能。
2.在模块化设计中
模块的扇出是指模块的直属下层模块的个数，如图7．8所示。图7．8中，平均的扇出是2。一般认为，设计得好的系统平均扇出是3或4。
图7.8模块的扇出
一个模块的扇出数过大或过小都不理想，过大比过小更严重。一般认为扇出的上限不超过7。扇出过大意味着管理模块过于复杂，需要控制和协调过多的下级。解决的办法是适当增加中间层次。
一个模块的扇入是指有多少个上级模块调用它。扇人越大，表示该模块被更多的上级模块共享。这当然是我们所希望的。但是不能为了获得高扇人而不惜代价，例如把彼此无关的功能凑在一起构成一个模块，虽然扇人数高了，但这样的模块内聚程度必然低。这是我们应避免的。
设计得好的系统，上层模块有较高的扇出，下层模块有较高的扇人。其结构图像清真寺的塔，上面尖，中间宽，下面小。
多扇出问题，通常是指用一个节点驱动多个下级逻辑器件，此问题会严重影响FPGA布线的稳定性，设计的时候要多加注意，此时采用的是复制寄存器策略。
举个例子： CLK为系统时钟，M为1MHz方波信号，由于M信号驱动的模块较多，所以M的扇出较多，为了减少扇出，用系统时钟采样，将M此文来自: 马开东博客
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在软件结构化设计中，好的软件结构设计应该力求做到( & )。A、顶层扇出较少，中间层扇出较高，底层模块低扇入B、顶层扇出较高，中间层扇出较少，底层模块高扇入C、顶层扇入较少，中间层扇出较高，底层模块高扇入D、顶层扇入较少，中间层扇入较高，底层模块低扇入&
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